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FASTCOM GFSCC-232

Référence - P/N: 12011001
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899.00€ HT

FASTCOM GFSCC-232 cartes de communication synchrones RS232

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Description
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Fastcom: GFSCC-232
cartes de communication synchrones RS232

Conçu pour se conformer aux dernières spécifications PCI, l'adaptateur Fastcom: GFSCC-232 Universal PCI (PCI version 2.3) fonctionnera dans les emplacements PCI 5 V et 3,3 V. Cela signifie que la carte fonctionnera dans les emplacements PCI-X haute vitesse que l'on trouve couramment dans la plupart des nouveaux serveurs, ainsi que dans les emplacements PCI standard des PC de bureau. Cette flexibilité permet d'utiliser une seule carte d'interface série sur une large gamme de différents types d'ordinateurs, y compris les systèmes informatiques actuels et futurs. L'adaptateur Fastcom: GFSCC-232 est l'un des adaptateurs de communications synchrones les plus avancés de l'industrie. Le Fastcom: GFSCC-232 prend en charge des débits de données jusqu'à 1 Mbit / s. Le Fastcom: GFSCC-232 est un adaptateur double canal, chacun étant configurable individuellement pour utiliser les protocoles HDLC / SDLC, ASYNC (en utilisant 16C950 UARTS) ou Fastcom®: X-Sync. Bien que similaire aux familles d'adaptateurs ESCC et SuperFastcom, le GFSCC-232 élargit nos adaptateurs précédents. L'expansion la plus notable est la longévité des composants de la carte. Face à l'inévitabilité de l'obsolescence, Commtech a décidé de mettre un terme aux problèmes de durée de vie qui affligent la plupart des clients informatiques. Nous avons conçu un contrôleur de communication série en tenant compte des besoins de nos clients et avons construit une carte autour de celui-ci. Entièrement conçu et détenu par Commtech, Inc, ce SCC basé sur FPGA possède la plupart des fonctionnalités que vous avez l'habitude de voir dans un produit Fastcom de qualité. Il comprend également quelques nouvelles fonctionnalités qui proviennent directement des demandes des clients. Si la technologie FPGA existante est abandonnée par le fabricant de puces, la conception peut simplement être reciblée vers la prochaine génération de puces FPGA sans impact sur la compatibilité.

Conforme RoHS 3 2015/863 / UE
COMM. CONTRÔLEUR: Fastcom F-Core
INTERFACE: RS232
CONFIGURATION DU CONNECTEUR: Ensemble de câbles (2 pi) - Fiche HDDB62 à deux fiches DB25
INTERFACE BUS: PCI version 2.3
PLAGE DE BAUD: En utilisant le générateur d'horloge programmable indépendant de l'utilisateur en conjonction avec le registre de débit en bauds, pratiquement n'importe quel débit en bauds de 1 bps à 1 Mbit / s peut être atteint.
Les débits de données maximaux sont des estimations. Ils sont grandement affectés par un certain nombre de facteurs différents. Voir la section sur les débits de données du manuel pour plus de détails. Cela est possible tant que les paramètres de fonctionnement sont raisonnables. Si vous avez des questions sur la capacité de la carte à répondre à vos besoins, veuillez contacter le support technique.
EXIGENCES D'ALIMENTATION: + 5V @ 450mA (typique)
ENVIRONNEMENT:
Plage de températures de fonctionnement: 0 à 70 C
Humidité: 0 à 90% (sans condensation)
DIMENSIONS:
Demi-longueur pleine hauteur
Hauteur: 4,2 ″ (107 mm)
Longueur: 4,7 ″ (119,91 mm)
Poids: 0,2 lb (90,719 g)

 

Jamais obsolète
Firmware personnalisable: le firmware de nos gammes de produits GFSCC ​​et GSuperFSCC est entièrement personnalisable. Si vous avez une exigence de fonctionnalité que vous ne voyez pas répertoriée, veuillez nous contacter pour modifier notre firmware pour répondre à vos besoins spécifiques.
Haute vitesse: jusqu'à 1 Mbit / s
Pilotes: RS232
Mode True-Async. Chaque port peut être configuré pour utiliser les UART 16C950 intégrés et peut être utilisé comme un port série (COM) standard.
Gestion automatique RS-485
DEL d'état de transmission et de réception pour chaque port.
Réseau de terminaison RS-485 intégré pour chaque paire de signaux de réception
Deux canaux série full duplex indépendants
Mécanisme d'horloge de données sélectionnable indépendamment par canal et par direction
Horloges Rx et Tx générées en externe
Horloges Rx et Tx générées en interne
Récupération d'horloge DPLL sur puce
Générateurs de vitesse de transmission indépendants
FIFO
RxFIFO = 8 Ko par port (modes non uart)
TxFIFO = 4 Ko par port (modes non uart)
Niveaux de déclenchement d'interruption programmables (filigrane)
Protocoles de données
HDLC / SDLC
Les familles de cartes GFSCC ​​et GSuperFSCC prennent entièrement en charge la convention de trame HDLC. Il ne prend pas en charge le décodage automatique des champs de contrôle SDLC. Si des octets de contrôle sont présents dans les trames reçues, ils seront transmis à l'utilisateur comme s'ils faisaient partie du champ info. Si des octets de contrôle doivent être transmis, ils devront être générés par l'utilisateur et écrits comme s'il s'agissait de données.
Détection et transmission automatiques des drapeaux
Format de trame général: 0x7e, info, CRC, CRC, [CRC, CRC,] 0x7e
Format de trame avec adresse masquable activée: 0x7e, adresse, [adresse,] info, CRC, CRC, [CRC, CRC,] 0x7e
Aucune insertion / suppression
Une insertion / suppression
Mode indicateur partagé: l'indicateur d'ouverture et l'indicateur de fermeture des trames dos à dos peuvent utiliser le même indicateur.
Détection d'erreur (abandon, dépassement, sous-exécution, erreur CRC, trame trop longue / courte)
Peut utiliser CRC8, CRC-CCITT ou CRC32
Séquence de synchronisation arbitraire (Fastcom®: X-Sync)
N'importe quelle séquence de synchronisation de trame de début / fin de jusqu'à 4 octets
Format de trame: SYN1, [SYN2, SYN3, SYN4,] info, [CRC, CRC, CRC, CRC,] [TCR1, TCR2, TCR3, TCR4]
Masquable: peut sélectionner tout ou partie de la séquence de synchronisation pour une correspondance de synchronisation
Détection de séquence de terminaison jusqu'à 4 octets (masquable)
Mode indicateur partagé: l'indicateur d'ouverture et l'indicateur de fermeture des trames dos à dos peuvent utiliser le même indicateur.
Détection d'erreur
Peut utiliser n'importe laquelle des méthodes CRC disponibles
Mode transparent
Entièrement transparent (pas de cadrage ni de manipulation de bits)
Peut se synchroniser en utilisant des signaux de synchronisation de trame sélectionnables
Schémas de codage des données:
NRZ, NRZI, FM0 / FM1, Manchester
Signaux de synchronisation de trame sélectionnables
Largeur d'impulsion d'une horloge au premier bit de données
Largeur d'impulsion d'une horloge au dernier bit de données
Largeur d'impulsion de tout le cadre
Insérez éventuellement un nombre variable de cycles d'horloge entre les données et le FSS
Polarité sélectionnable
Contrôle de flux de données en option à l'aide de lignes de contrôle de modem (RTS, CTS)
Préambule et postambule 8 bits programmables avec taux de répétition sélectionnable (1 à 255 répétitions)
Les données peuvent être orientées en tant que MSB sélectionnable en premier ou LSB en premier
Remplissage temporel inter-images: inactif en tant que 1 répétitif, drapeaux ou séquences de synchronisation
Prise en charge du CRC
Traitement automatique dans le sens émission / réception
CRC-CCITT (également appelé CRC16-ITU) (HDLC), CRC32 (HDLC), CRC16, CRC8 (HDLC)
Option CRC transparente
Réinitialiser comme 0/1
Transmission continue de 1 à 4096 octets
Débits de données sélectionnables
Débit de données synchrone (cadencé en interne) jusqu'à 1 Mbit / s
Débits de données synchrones (horloge externe) jusqu'à 1 Mbit / s
Débit de données asynchrone (récupération d'horloge DPLL) jusqu'à 1 Mbit / s
Ces débits de données sont les débits maximums garantis. Bien qu'il soit possible de synchroniser les 232 puces de l'émetteur-récepteur à des vitesses plus rapides, elles sont grandement affectées par un certain nombre de facteurs différents. Voir la section Baud Rates du manuel pour plus de détails.
Inversion de données et d'horloge
Minuterie matérielle interruptible
Transmettre une seule trame à l'expiration du temporisateur matériel
Bibliothèques incluses:
C
C ++
.NET
Python
Analyseur de réseau
Wireshark
Câble, documentation et pilotes logiciels inclus

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